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fpga lvds内核仿真还需要什么文件

归档日期:08-06       文本归类:仿真      文章编辑:爱尚语录

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  采纳数:24761获赞数:318012011年中山职业技术学院毕业,现担任毅衣公司京东小二向TA提问展开全部1. verilog。verilog中时序逻辑和组合逻辑写法、运算符、企业设计规范、例化方法等就是核心知识;模块结构、信号类型等是识记内容,理解就可以的;function、task、读写文件等就纯粹没必要学了。2. 测试文件。编写代码后,必须对代码仿真,这个时候就要编写测试文件了。那么要懂得时钟和复位的产生方法、信号产生方法、例化等是核心知识,其他内容就没啥必要的。3. modelsim。modelsim是仿真工具,新建工程、编译工程、解决提示的错误、仿真工程、查看波形、定位问题和解决问题等是核心知识,其他工具中更高级的功能线. quartus。当仿真正确后,就要加载工程到板子上跑跑了。quartus的新建工程、综合、配置管脚、下载工程等就是核心知识,会这几步骤就可以了。5. signaltap。当电路上板后,发现现象不对,此时就需要signaltap去查看芯片内部发生了什么事。signaltap原理、设置、触发条件等设置就是核心知识。要懂得如何通过signaltap去定位问题。6. 至简设计法学习。经过前面几步,相信你可以把已有的工程下载到板上看现象了。但你此时还没能力做设计,不懂得如何下手。这时要学习至简设计法。它会教你如何一步一步傻瓜似去完成一个复杂电路的设计,里面很多有实用技巧,熟练运用这些技巧,有助于你写出非常优秀的代码。

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